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Un eficiente red neuronal convolucional basada en FPGA para clasificación: Ad-MobileNet

Autores: Bouguezzi, Safa; Fredj, Hana Ben; Belabed, Tarek; Valderrama, Carlos; Faiedh, Hassene; Souani, Chokri

Idioma: Inglés

Editor: MDPI

Año: 2021

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Acceso abierto

Artículo científico
2021

Un eficiente red neuronal convolucional basada en FPGA para clasificación: Ad-MobileNet


Categoría

Ingeniería y Tecnología

Subcategoría

Ingeniería Eléctrica y Electrónica

Palabras clave

Redes neuronales convolucionales
Aceleración de hardware
Matrices de compuertas programables en campo
Segmentación de objetos
Clasificación de imágenes
Modelo de implementación basado en FPGA

Licencia

CC BY-SA – Atribución – Compartir Igual

Consultas: 33

Citaciones: Sin citaciones


Descripción
Las redes neuronales convolucionales (CNN) continúan dominando la investigación en el área de la aceleración de hardware utilizando Arrays de compuertas programables en campo (FPGA), demostrando su efectividad en una variedad de aplicaciones de visión por computadora como la segmentación de objetos, clasificación de imágenes, detección de rostros y reconocimiento de señales de tráfico, entre otros. Sin embargo, existen numerosas limitaciones para implementar CNN en FPGA, incluyendo la memoria en chip limitada, el tamaño de la CNN y los parámetros de configuración. Este documento presenta Ad-MobileNet, un modelo avanzado de CNN inspirado en el modelo base MobileNet. El modelo propuesto utiliza un motor Ad-depth, que es una versión mejorada de la unidad de convolución separable en profundidad. Además, proponemos un modelo de implementación basado en FPGA que admite las funciones de activación Mish, TanhExp y ReLU. Los resultados experimentales utilizando el conjunto de datos CIFAR-10 muestran que nuestro Ad-MobileNet tiene una precisión de clasificación del 88.76% mientras requiere pocos recursos de hardware computacional. En comparación con los métodos de última generación, nuestro método propuesto tiene una tasa de reconocimiento bastante alta mientras utiliza menos recursos de hardware computacional. De hecho, el modelo propuesto ayuda a reducir los recursos de hardware en más del 41% en comparación con el del modelo base.

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